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1
Esquema para sincronizar relógios conectados por rede de comunicação por comutação de pacotes.
Esquema para sincronizar relógios conectados por rede de comunicação por comutação de pacotes.
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Esquema para sincronizar relógios conectados por rede de comunicação por comutação de pacotes.

Santos, Rodrigo Vieira Dos

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola Politécnica 2012-06-14

Acesso online. A biblioteca também possui exemplares impressos.

2
Estudo do jitter de fase em redes de distribuição de sinais de tempo.
Estudo do jitter de fase em redes de distribuição de sinais de tempo.
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Estudo do jitter de fase em redes de distribuição de sinais de tempo.

Bueno, Átila Madureira

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola Politécnica 2009-06-04

Acesso online. A biblioteca também possui exemplares impressos.

3
A 60-Gb/s 1.2-pJ/bit 1/4-Rate PAM-4 Receiver With a Jitter Compensation CDR
A 60-Gb/s 1.2-pJ/bit 1/4-Rate PAM-4 Receiver With a Jitter Compensation CDR
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 60-Gb/s 1.2-pJ/bit 1/4-Rate PAM-4 Receiver With a Jitter Compensation CDR

Wang, Li ; Zhang, Zhao ; Wang, Can ; Azmat, Rehan ; Shi, Weimin ; Yue, C. Patrick

IEEE journal of solid-state circuits, 2024-02, Vol.59 (2), p.1-15 [Periódico revisado por pares]

New York: IEEE

Texto completo disponível

Citações Citado por
4
Clock Period-Jitter Measurement With Low-Noise Runtime Calibration for Chips in FinFET CMOS
Clock Period-Jitter Measurement With Low-Noise Runtime Calibration for Chips in FinFET CMOS
Material Type:
Artigo 		Adicionar ao Meu Espaço

Clock Period-Jitter Measurement With Low-Noise Runtime Calibration for Chips in FinFET CMOS

Wang, Jinn-Shyan ; Chou, Pei-Yuan

IEEE transactions on circuits and systems. I, Regular papers, 2024-03, p.1-8 [Periódico revisado por pares]

IEEE

Texto completo disponível

Citações Citado por
5
A 4-to-10.5 Gb/s Continuous-Rate Digital Clock and Data Recovery With Automatic Frequency Acquisition
A 4-to-10.5 Gb/s Continuous-Rate Digital Clock and Data Recovery With Automatic Frequency Acquisition
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 4-to-10.5 Gb/s Continuous-Rate Digital Clock and Data Recovery With Automatic Frequency Acquisition

Guanghua Shu ; Woo-Seok Choi ; Saxena, Saurabh ; Talegaonkar, Mrunmay ; Anand, Tejasvi ; Elkholy, Ahmed ; Elshazly, Amr ; Hanumolu, Pavan Kumar

IEEE journal of solid-state circuits, 2016-02, Vol.51 (2), p.428-439 [Periódico revisado por pares]

New York: IEEE

Texto completo disponível

Citações Citado por
6
Satellite Jitter Estimation and Validation Using Parallax Images
Satellite Jitter Estimation and Validation Using Parallax Images
Material Type:
Artigo 		Adicionar ao Meu Espaço

Satellite Jitter Estimation and Validation Using Parallax Images

Pan, Jun ; Che, Chengbang ; Zhu, Ying ; Wang, Mi

Sensors (Basel, Switzerland), 2017-01, Vol.17 (1), p.83-83 [Periódico revisado por pares]

Switzerland: MDPI AG

Texto completo disponível

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7
The Accuracy of the Gaussian Tail and Dual Dirac Model in Jitter Histogram and Probability Density Functions
The Accuracy of the Gaussian Tail and Dual Dirac Model in Jitter Histogram and Probability Density Functions
Material Type:
Artigo 		Adicionar ao Meu Espaço

The Accuracy of the Gaussian Tail and Dual Dirac Model in Jitter Histogram and Probability Density Functions

Soliman, George

IEEE transactions on electromagnetic compatibility, 2022-12, Vol.64 (6), p.2207-2217 [Periódico revisado por pares]

New York: IEEE

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8
Jitter Decomposition by Convolutional Neural Networks
Jitter Decomposition by Convolutional Neural Networks
Material Type:
Artigo 		Adicionar ao Meu Espaço

Jitter Decomposition by Convolutional Neural Networks

Ren, Nan ; Fu, Zaiming ; Zhou, Dandan ; Liu, Hanglin ; Wu, Zhong ; Tian, Shulin

IEEE transactions on electromagnetic compatibility, 2021-10, Vol.63 (5), p.1550-1561 [Periódico revisado por pares]

New York: IEEE

Texto completo disponível

Citações Citado por
9
A Low Noise Sub-Sampling PLL in Which Divider Noise is Eliminated and PD/CP Noise is Not Multiplied by N
A Low Noise Sub-Sampling PLL in Which Divider Noise is Eliminated and PD/CP Noise is Not Multiplied by N
Material Type:
Artigo 		Adicionar ao Meu Espaço

A Low Noise Sub-Sampling PLL in Which Divider Noise is Eliminated and PD/CP Noise is Not Multiplied by N

Xiang Gao ; Klumperink, E.A.M. ; Bohsali, M. ; Nauta, B.

IEEE journal of solid-state circuits, 2009-12, Vol.44 (12), p.3253-3263 [Periódico revisado por pares]

IEEE

Texto completo disponível

Citações Citado por
10
Analysis and Verification of Jitter in Bang-Bang Clock and Data Recovery Circuit With a Second-Order Loop Filter
Analysis and Verification of Jitter in Bang-Bang Clock and Data Recovery Circuit With a Second-Order Loop Filter
Material Type:
Artigo 		Adicionar ao Meu Espaço

Analysis and Verification of Jitter in Bang-Bang Clock and Data Recovery Circuit With a Second-Order Loop Filter

Ge, Xinyi ; Chen, Yong ; Zhao, Xiaoteng ; Mak, Pui-In ; Martins, Rui P.

IEEE transactions on very large scale integration (VLSI) systems, 2019-10, Vol.27 (10), p.2223-2236 [Periódico revisado por pares]

New York: IEEE

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  1. Piqueira, J  (1)
  2. Bueno, Á  (1)
  3. Monteiro, L  (1)
  4. Santos, R  (1)
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Data de Publicação 

De até
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  1. Antes de1965  (46)
  2. 1965Até1978  (202)
  3. 1979Até1992  (611)
  4. 1993Até2007  (6.618)
  5. Após 2007  (8.553)
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Idioma 

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Deste Autor:

  1. Piqueira, J
  2. Bueno, Á
  3. Monteiro, L
  4. Santos, R

Neste Assunto:

  1. Jitter
  2. Science & Technology
  3. Technology
  4. Engineering
  5. Engineering, Electrical & Electronic

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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