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Multiphysics Modeling of RF and Microwave High-Power Transistors: SPECIAL ISSUE ON 2012 INTERNATIONAL MICROWAVE SYMPOSIUM
Multiphysics Modeling of RF and Microwave High-Power Transistors: SPECIAL ISSUE ON 2012 INTERNATIONAL MICROWAVE SYMPOSIUM
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Multiphysics Modeling of RF and Microwave High-Power Transistors: SPECIAL ISSUE ON 2012 INTERNATIONAL MICROWAVE SYMPOSIUM

AAEN, Peter H ; WOOD, John ; BRIDGES, Daren ; LEI ZHANG ; JOHNSON, Eric ; PLA, Jaime A ; BARBIERI, Travis ; SNOWDEN, Christopher M ; EVERETT, John P ; KEARNEY, Michael J

IEEE transactions on microwave theory and techniques, 2012, Vol.60 (12), p.4013-4023 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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On the development of CAD techniques suitable for the design of high-power RF transistors
On the development of CAD techniques suitable for the design of high-power RF transistors
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On the development of CAD techniques suitable for the design of high-power RF transistors

Aaen, P.H. ; Pla, J.A. ; Balanis, C.A.

IEEE transactions on microwave theory and techniques, 2005-10, Vol.53 (10), p.3067-3074 [Periódico revisado por pares]

New York, NY: IEEE

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3
PBS: proven Boolean simplification
PBS: proven Boolean simplification
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PBS: proven Boolean simplification

Aagaard, M. ; Leeser, M.

IEEE transactions on computer-aided design of integrated circuits and systems, 1994-04, Vol.13 (4), p.459-470 [Periódico revisado por pares]

New York, NY: IEEE

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4
A 2.2 mA 4.3 mm2 ASIC for a 1000°/s 2-Axis Capacitive Micro-Gyroscope: SPECIAL ISSUE ON THE 36th EUROPEAN SOLID-STATE CIRCUITS CONFERENCE (ESSCIRC)
A 2.2 mA 4.3 mm2 ASIC for a 1000°/s 2-Axis Capacitive Micro-Gyroscope: SPECIAL ISSUE ON THE 36th EUROPEAN SOLID-STATE CIRCUITS CONFERENCE (ESSCIRC)
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A 2.2 mA 4.3 mm2 ASIC for a 1000°/s 2-Axis Capacitive Micro-Gyroscope: SPECIAL ISSUE ON THE 36th EUROPEAN SOLID-STATE CIRCUITS CONFERENCE (ESSCIRC)

AALTONEN, Lasse ; KALANTI, Antti ; PULKKINEN, Mika ; PAAVOLA, Matti ; KAMARAINEN, Mika ; HALONEN, Kari A. I

IEEE journal of solid-state circuits, 2011, Vol.46 (7), p.1682-1692 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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5
Transient current testing of dynamic CMOS circuits
Transient current testing of dynamic CMOS circuits
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Transient current testing of dynamic CMOS circuits

Aaraj, N. ; Nazer, A. ; Chehab, A. ; Kayssi, A.

19th IEEE International Symposium on Defect and Fault Tolerance in VLSI Systems, 2004. DFT 2004. Proceedings, 2004, p.264-271

Los Alamitos CA: IEEE

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6
Hybrid Architectures for Efficient and Secure Face Authentication in Embedded Systems
Hybrid Architectures for Efficient and Secure Face Authentication in Embedded Systems
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Hybrid Architectures for Efficient and Secure Face Authentication in Embedded Systems

Aaraj, N. ; Ravi, S. ; Raghunathan, A. ; Jha, N.K.

IEEE transactions on very large scale integration (VLSI) systems, 2007-03, Vol.15 (3), p.296-308 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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7
A surface-potential-based high-voltage compact LDMOS transistor model
A surface-potential-based high-voltage compact LDMOS transistor model
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A surface-potential-based high-voltage compact LDMOS transistor model

Aarts, A. ; D'Halleweyn, N. ; van Langevelde, R.

IEEE transactions on electron devices, 2005-05, Vol.52 (5), p.999-1007 [Periódico revisado por pares]

New York, NY: IEEE

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8
Compact modeling of high-voltage LDMOS devices including quasi-saturation
Compact modeling of high-voltage LDMOS devices including quasi-saturation
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Compact modeling of high-voltage LDMOS devices including quasi-saturation

Aarts, A.C.T. ; Kloosterman, W.J.

IEEE transactions on electron devices, 2006-04, Vol.53 (4), p.897-902 [Periódico revisado por pares]

New York, NY: IEEE

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9
An efficient macro-cell placement algorithm
An efficient macro-cell placement algorithm
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An efficient macro-cell placement algorithm

Aarts, E.H.L. ; de Bont, F.M.J. ; Korst, J.H.M. ; Rongen, J.M.J.

Integration (Amsterdam), 1991, Vol.10 (3), p.299-317 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
Multi-objective circuit partitioning for cutsize and path-based delay minimization
Multi-objective circuit partitioning for cutsize and path-based delay minimization
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Multi-objective circuit partitioning for cutsize and path-based delay minimization

Ababei, Cristinel ; Selvakkumaran, Navaratnasothie ; Bazargan, Kia ; Karypis, George

Digest of technical papers - IEEE/ACM International Conference on Computer-Aided Design, 2002, p.181-185

New York, NY, USA: ACM

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