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Characterization and Optimization of Inverted-T FinFET Under Nanoscale Dimensions
Characterization and Optimization of Inverted-T FinFET Under Nanoscale Dimensions
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Characterization and Optimization of Inverted-T FinFET Under Nanoscale Dimensions

Yu, Eunseon ; Heo, Keun ; Cho, Seongjae

IEEE transactions on electron devices, 2018-08, Vol.65 (8), p.3521-3527 [Periódico revisado por pares]

New York: IEEE

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Device Exploration of NanoSheet Transistors for Sub-7-nm Technology Node
Device Exploration of NanoSheet Transistors for Sub-7-nm Technology Node
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Device Exploration of NanoSheet Transistors for Sub-7-nm Technology Node

Doyoung Jang ; Yakimets, Dmitry ; Eneman, Geert ; Schuddinck, Pieter ; Bardon, Marie Garcia ; Raghavan, Praveen ; Spessot, Alessio ; Verkest, Diederik ; Mocuta, Anda

IEEE transactions on electron devices, 2017-06, Vol.64 (6), p.2707-2713 [Periódico revisado por pares]

IEEE

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Hybrid Integration of Gate-All-Around Stacked Si Nanosheet FET and Si/SiGe Super-Lattice FinFET to Optimize 6T-SRAM for N3 Node and Beyond
Hybrid Integration of Gate-All-Around Stacked Si Nanosheet FET and Si/SiGe Super-Lattice FinFET to Optimize 6T-SRAM for N3 Node and Beyond
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Hybrid Integration of Gate-All-Around Stacked Si Nanosheet FET and Si/SiGe Super-Lattice FinFET to Optimize 6T-SRAM for N3 Node and Beyond

Zhang, Xuexiang ; Yao, Jiaxin ; Luo, Yanna ; Cao, Lei ; Zheng, Yantong ; Zhang, Qingzhu ; Wu, Zhenhua ; Yin, Huaxiang

IEEE transactions on electron devices, 2024-03, Vol.71 (3), p.1776-1783 [Periódico revisado por pares]

New York: IEEE

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FinFET Evolution Toward Stacked-Nanowire FET for CMOS Technology Scaling
FinFET Evolution Toward Stacked-Nanowire FET for CMOS Technology Scaling
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FinFET Evolution Toward Stacked-Nanowire FET for CMOS Technology Scaling

Peng Zheng ; Connelly, Daniel ; Fei Ding ; Tsu-Jae King Liu

IEEE transactions on electron devices, 2015-12, Vol.62 (12), p.3945-3950 [Periódico revisado por pares]

New York: IEEE

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Simulation-Based Study of High-Permittivity Inserted-Oxide FinFET With Low-Permittivity Inner Spacers
Simulation-Based Study of High-Permittivity Inserted-Oxide FinFET With Low-Permittivity Inner Spacers
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Simulation-Based Study of High-Permittivity Inserted-Oxide FinFET With Low-Permittivity Inner Spacers

Wu, Yi-Ting ; Chiang, Meng-Hsueh ; Chen, Jone F. ; Liu, Tsu-Jae King

IEEE transactions on electron devices, 2021-11, Vol.68 (11), p.5529-5534 [Periódico revisado por pares]

New York: IEEE

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DC response, low-frequency noise, and TID-induced mechanisms in 16-nm FinFETs for high-energy physics experiments
DC response, low-frequency noise, and TID-induced mechanisms in 16-nm FinFETs for high-energy physics experiments
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DC response, low-frequency noise, and TID-induced mechanisms in 16-nm FinFETs for high-energy physics experiments

Bonaldo, Stefano ; Ma, Teng ; Mattiazzo, Serena ; Baschirotto, Andrea ; Enz, Christian ; Fleetwood, Daniel M. ; Paccagnella, Alessandro ; Gerardin, Simone

Nuclear instruments & methods in physics research. Section A, Accelerators, spectrometers, detectors and associated equipment, 2022-06, Vol.1033, p.166727, Article 166727 [Periódico revisado por pares]

Elsevier B.V

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(Ultra)Wide-Bandgap Vertical Power FinFETs
(Ultra)Wide-Bandgap Vertical Power FinFETs
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(Ultra)Wide-Bandgap Vertical Power FinFETs

Zhang, Yuhao ; Palacios, Tomas

IEEE transactions on electron devices, 2020-10, Vol.67 (10), p.3960-3971 [Periódico revisado por pares]

New York: IEEE

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Challenges and Limitations of CMOS Scaling for FinFET and Beyond Architectures
Challenges and Limitations of CMOS Scaling for FinFET and Beyond Architectures
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Challenges and Limitations of CMOS Scaling for FinFET and Beyond Architectures

Razavieh, Ali ; Zeitzoff, Peter ; Nowak, Edward J.

IEEE transactions on nanotechnology, 2019, Vol.18, p.999-1004 [Periódico revisado por pares]

New York: IEEE

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14-nm FinFET Technology for Analog and RF Applications
14-nm FinFET Technology for Analog and RF Applications
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14-nm FinFET Technology for Analog and RF Applications

Singh, Jagar ; Ciavatti, J. ; Sundaram, K. ; Wong, J. S. ; Bandyopadhyay, A. ; Zhang, X. ; Li, S. ; Bellaouar, A. ; Watts, J. ; Lee, J. G. ; Samavedam, S. B.

IEEE transactions on electron devices, 2018-01, Vol.65 (1), p.31-37 [Periódico revisado por pares]

IEEE

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Design Insights of Nanosheet FET and CMOS Circuit Applications at 5-nm Technology Node
Design Insights of Nanosheet FET and CMOS Circuit Applications at 5-nm Technology Node
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Design Insights of Nanosheet FET and CMOS Circuit Applications at 5-nm Technology Node

Sreenivasulu, V. Bharath ; Narendar, Vadthiya

IEEE transactions on electron devices, 2022-08, Vol.69 (8), p.4115-4122 [Periódico revisado por pares]

New York: IEEE

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