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Hybrid Integration of Gate-All-Around Stacked Si Nanosheet FET and Si/SiGe Super-Lattice FinFET to Optimize 6T-SRAM for N3 Node and Beyond
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Hybrid Integration of Gate-All-Around Stacked Si Nanosheet FET and Si/SiGe Super-Lattice FinFET to Optimize 6T-SRAM for N3 Node and Beyond

Zhang, Xuexiang ; Yao, Jiaxin ; Luo, Yanna ; Cao, Lei ; Zheng, Yantong ; Zhang, Qingzhu ; Wu, Zhenhua ; Yin, Huaxiang

IEEE transactions on electron devices, 2024-03, Vol.71 (3), p.1776-1783 [Periódico revisado por pares]

New York: IEEE

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2
14-nm FinFET Technology for Analog and RF Applications
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14-nm FinFET Technology for Analog and RF Applications

Singh, Jagar ; Ciavatti, J. ; Sundaram, K. ; Wong, J. S. ; Bandyopadhyay, A. ; Zhang, X. ; Li, S. ; Bellaouar, A. ; Watts, J. ; Lee, J. G. ; Samavedam, S. B.

IEEE transactions on electron devices, 2018-01, Vol.65 (1), p.31-37 [Periódico revisado por pares]

IEEE

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3
Exploration of Negative Capacitance in Gate-All-Around Si Nanosheet Transistors
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Exploration of Negative Capacitance in Gate-All-Around Si Nanosheet Transistors

Sakib, Fahimul Islam ; Hasan, Md. Azizul ; Hossain, Mainul

IEEE transactions on electron devices, 2020-11, Vol.67 (11), p.5236-5242 [Periódico revisado por pares]

New York: IEEE

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4
Comparison of Gate-Metal Work Function Variability Between Ge and Si p-Channel FinFETs
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Comparison of Gate-Metal Work Function Variability Between Ge and Si p-Channel FinFETs

Nawaz, Sk Masum ; Dutta, Souvik ; Mallik, Abhijit

IEEE transactions on electron devices, 2015-12, Vol.62 (12), p.3951-3956 [Periódico revisado por pares]

New York: IEEE

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5
Performance Investigation of Novel Pt/Pd-SiO2 Junctionless FinFET as a High Sensitive Hydrogen Gas Sensor for Industrial Applications
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Performance Investigation of Novel Pt/Pd-SiO2 Junctionless FinFET as a High Sensitive Hydrogen Gas Sensor for Industrial Applications

Sehgal, Himani Dua ; Pratap, Yogesh ; Gupta, Mridula ; Kabra, Sneha

IEEE sensors journal, 2021-06, Vol.21 (12), p.13356-13363 [Periódico revisado por pares]

IEEE

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6
Impact of Sub- \mu m Wafer Thinning on Latch-Up Risk in DTCO/STCO Scaling Era
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Impact of Sub- \mu m Wafer Thinning on Latch-Up Risk in DTCO/STCO Scaling Era

Serbulova, Kateryna ; Chen, Shih-Hung ; Hellings, Geert ; Veloso, Anabela ; Jourdain, Anne ; Boeck, Jo De ; Groeseneken, Guido

IEEE transactions on electron devices, 2024-04, p.1-6 [Periódico revisado por pares]

IEEE

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7
Highly Scaled GaN Complementary Technology on a Silicon Substrate
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Highly Scaled GaN Complementary Technology on a Silicon Substrate

Xie, Qingyun ; Yuan, Mengyang ; Niroula, John ; Sikder, Bejoy ; Greer, James A. ; Rajput, Nitul S. ; Chowdhury, Nadim ; Palacios, Tomas

IEEE transactions on electron devices, 2023-04, Vol.70 (4), p.1-8 [Periódico revisado por pares]

New York: IEEE

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8
Monte Carlo Comparison of n-Type and p-Type Nanosheets With FinFETs: Effect of the Number of Sheets
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Monte Carlo Comparison of n-Type and p-Type Nanosheets With FinFETs: Effect of the Number of Sheets

Bufler, F. M. ; Jang, D. ; Hellings, G. ; Eneman, G. ; Matagne, P. ; Spessot, A. ; Na, M. H.

IEEE transactions on electron devices, 2020-11, Vol.67 (11), p.4701-4704 [Periódico revisado por pares]

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9
Suppression of Statistical Variability in Junctionless FinFET Using Accumulation-Mode and Charge Plasma Structure
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Suppression of Statistical Variability in Junctionless FinFET Using Accumulation-Mode and Charge Plasma Structure

Hu, Luodan ; Lou, Haijun ; Li, Wentao ; Chang, Kuan-Chang ; Lin, Xinnan

IEEE transactions on electron devices, 2021-01, Vol.68 (1), p.399-404 [Periódico revisado por pares]

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10
Improved SOI FinFETs Performance With Low-Temperature Deuterium Annealing
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Improved SOI FinFETs Performance With Low-Temperature Deuterium Annealing

Ku, Ja-Yun ; Yu, Ji-Man ; Wang, Dong-Hyun ; Jung, Dae-Han ; Han, Joon-Kyu ; Choi, Yang-Kyu ; Park, Jun-Young

IEEE transactions on electron devices, 2023-07, Vol.70 (7), p.3958-3962 [Periódico revisado por pares]

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