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Refinado por: Nome da Publicação: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems remover
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Support-Reducing Decomposition for FPGA Mapping
Support-Reducing Decomposition for FPGA Mapping
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Support-Reducing Decomposition for FPGA Mapping

Machado, Lucas ; Cortadella, Jordi

IEEE transactions on computer-aided design of integrated circuits and systems, 2020-01, Vol.39 (1), p.213-224 [Periódico revisado por pares]

New York: IEEE

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Area-Optimal Transistor Folding for 1-D Gridded Cell Design
Area-Optimal Transistor Folding for 1-D Gridded Cell Design
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Area-Optimal Transistor Folding for 1-D Gridded Cell Design

Cortadella, Jordi

IEEE transactions on computer-aided design of integrated circuits and systems, 2013-11, Vol.32 (11), p.1708-1721 [Periódico revisado por pares]

IEEE

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Mix & Latch: Comparison With State-of-the-Art Retiming on a RISC-V Benchmark
Mix & Latch: Comparison With State-of-the-Art Retiming on a RISC-V Benchmark
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Mix & Latch: Comparison With State-of-the-Art Retiming on a RISC-V Benchmark

Lagostina, Lorenzo ; Minnella, Filippo ; Cortadella, Jordi ; Casu, Mario R. ; Lazarescu, Mihai T. ; Lavagno, Luciano

IEEE transactions on computer-aided design of integrated circuits and systems, 2024-07, Vol.43 (7), p.2229-2233 [Periódico revisado por pares]

IEEE

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Multilevel Dataflow-Driven Macro Placement Guided by RTL Structure and Analytical Methods
Multilevel Dataflow-Driven Macro Placement Guided by RTL Structure and Analytical Methods
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Multilevel Dataflow-Driven Macro Placement Guided by RTL Structure and Analytical Methods

Vidal-Obiols, Alex ; Cortadella, Jordi ; Petit, Jordi ; Galceran-Oms, Marc ; Martorell, Ferran

IEEE transactions on computer-aided design of integrated circuits and systems, 2021-12, Vol.40 (12), p.2542-2555 [Periódico revisado por pares]

New York: IEEE

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CNN-on-AWS: Efficient Allocation of Multikernel Applications on Multi-FPGA Platforms
CNN-on-AWS: Efficient Allocation of Multikernel Applications on Multi-FPGA Platforms
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CNN-on-AWS: Efficient Allocation of Multikernel Applications on Multi-FPGA Platforms

Shan, Junnan ; Lazarescu, Mihai T. ; Cortadella, Jordi ; Lavagno, Luciano ; Casu, Mario R.

IEEE transactions on computer-aided design of integrated circuits and systems, 2021-02, Vol.40 (2), p.301-314 [Periódico revisado por pares]

New York: IEEE

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Fast Energy-Optimal Multikernel DNN-Like Application Allocation on Multi-FPGA Platforms
Fast Energy-Optimal Multikernel DNN-Like Application Allocation on Multi-FPGA Platforms
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Fast Energy-Optimal Multikernel DNN-Like Application Allocation on Multi-FPGA Platforms

Shan, Junnan ; Lazarescu, Mihai T. ; Cortadella, Jordi ; Lavagno, Luciano ; Casu, Mario R.

IEEE transactions on computer-aided design of integrated circuits and systems, 2022-04, Vol.41 (4), p.1186-1190 [Periódico revisado por pares]

New York: IEEE

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Desynchronization: Synthesis of Asynchronous Circuits From Synchronous Specifications
Desynchronization: Synthesis of Asynchronous Circuits From Synchronous Specifications
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Desynchronization: Synthesis of Asynchronous Circuits From Synchronous Specifications

Cortadella, J. ; Kondratyev, A. ; Lavagno, L. ; Sotiriou, C.P.

IEEE transactions on computer-aided design of integrated circuits and systems, 2006-10, Vol.25 (10), p.1904-1921 [Periódico revisado por pares]

New York: IEEE

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8
Elastic Circuits
Elastic Circuits
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Elastic Circuits

Carmona, J. ; Cortadella, J. ; Kishinevsky, M. ; Taubin, A.

IEEE transactions on computer-aided design of integrated circuits and systems, 2009-10, Vol.28 (10), p.1437-1455 [Periódico revisado por pares]

New York: IEEE

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9
A Boolean Rule-Based Approach for Manufacturability-Aware Cell Routing
A Boolean Rule-Based Approach for Manufacturability-Aware Cell Routing
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A Boolean Rule-Based Approach for Manufacturability-Aware Cell Routing

Cortadella, Jordi ; Petit, Jordi ; Gomez, Sergio ; Moll, Francesc

IEEE transactions on computer-aided design of integrated circuits and systems, 2014-03, Vol.33 (3), p.409-422 [Periódico revisado por pares]

New York: IEEE

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10
Timing-driven logic bi-decomposition
Timing-driven logic bi-decomposition
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Timing-driven logic bi-decomposition

Cortadella, J.

IEEE transactions on computer-aided design of integrated circuits and systems, 2003-06, Vol.22 (6), p.675-685 [Periódico revisado por pares]

New York: IEEE

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