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1
Aplicação de teste estrutural para programas multithreads baseados em semáforos
Aplicação de teste estrutural para programas multithreads baseados em semáforos
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Aplicação de teste estrutural para programas multithreads baseados em semáforos

Felipe Sarmanho Paulo Sérgio Lopes de Souza; Simone do Rocio Senger de Souza; Adenilso da Silva Simão; International Symposium on Computer Architecture and High Performance Computing (19 Gramado 2007); Workshop on Languages and Tools for Parallel and Distributed Programming - LTPD (2007 Gramado)

[Proceedings] Gramado, 2007

Porto Alegre 2007

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-1636292 ) e outros locais(Acessar)

2
Amnésia um simulador de hierarquia de memória
Amnésia um simulador de hierarquia de memória
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Amnésia um simulador de hierarquia de memória

Bruno H. Oliveira Jordan H Santos; Paulo Sérgio Lopes de Souza; Sarita Mazzini Bruschi; Simone do Rocio Senger de Souza; Workshop sobre Educação em Arquitetura de Computadores - WEAC (3 2008 Campo Grande); International Symposium on Computer Architecture and High Performance Computing - SBAC - PAC (20 Campo Grande 2008)

Proceedings Campo Grande

S.l s.n 2008

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-1717832 ) e outros locais(Acessar)

3
Classes de computação paralela e exemplos de problemas que admitem algoritmos paralelos rápidos
Classes de computação paralela e exemplos de problemas que admitem algoritmos paralelos rápidos
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Classes de computação paralela e exemplos de problemas que admitem algoritmos paralelos rápidos

Routo Terada International Symposium on Computer Architecture and High Performance Computing - SBAC-PAD (1987 Gramado, RS)

Anais Porto Alegre : SBC, 1987

Porto Alegre SBC 1987

Localização: IME - Inst. Matemática e Estatística    (PROD-3199164 )(Acessar)

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Metodologias para desenvolvimento de mapas auto-organizáveis de Kohonen executados em FPGA.
Metodologias para desenvolvimento de mapas auto-organizáveis de Kohonen executados em FPGA.
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Metodologias para desenvolvimento de mapas auto-organizáveis de Kohonen executados em FPGA.

Sousa, Miguel Angelo De Abreu De

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola Politécnica 2018-05-21

Acesso online. A biblioteca também possui exemplares impressos.

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  1. Souza, P
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  3. Del Moral Hernandez, E
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Neste Assunto:

  1. Programação Concorrente
  2. Circuitos Fpga
  3. Fpga
  4. Processamento De Imagens
  5. Sistemas Distribuídos Larpcal

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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